使用Vivado Design Suite进行功率优化

功率优化是一个可选步骤，它通过使用时钟门控来优化动态功率。它既可以在Project模式下使用，也可以在Non-Project模式下使用，并且可以在逻辑优化之后或布局之后运行，以减少设计中的功率需求。功率优化包括Xilinx的智能时钟门控解决方案，这些解决方案可以在不改变功能的前提下，减少设计中的动态功率。

一、Vivado功率优化工具

Vivado功率优化工具会分析设计的所有部分，包括legacy和第三方IP块。它还会识别出可以将活动变化信号进行时钟门控的机会，因为这些信号并非在每个时钟周期都被读取。这减少了切换活动，进而降低了动态功耗。
1、使用时钟使能（CEs）
Vivado功率优化器充分利用了丰富的时钟使能（CEs）资源。功率优化会创建门控逻辑来驱动寄存器时钟使能，以便寄存器只在相关的时钟周期捕获数据。
在实际的硅芯片中，CEs实际上是用于门控时钟，而不是在D输入和触发器反馈Q输出之间进行选择。这提高了CE输入的性能，同时也降低了时钟功耗。
Vivado工具通过智能地应用时钟门控技术和其他功耗降低策略，帮助设计者创建出功耗更低、效率更高的FPGA设计。这种优化不仅减少了功耗，而且通常不会对设计的性能产生负面影响。
2、智能时钟门控

智能时钟门控还可以减少简单双端口或真双端口模式下专用块RAM的功耗，如下图2所示。
这些块包括多个使能信号：
• 数组使能（Array enable）
• 写使能（Write enable）
• 输出寄存器时钟使能（Output register clock enable）
大部分的功耗节省来自于使用数组使能。Vivado功率优化器实现了在没有数据写入且输出未被使用时减少功耗的功能。
通过智能地管理这些使能信号，Vivado工具能够在不需要访问或更新块RA