单端口RAM实现FIFO

最新推荐文章于 2025-07-17 12:30:51 发布
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分类专栏： 数字IC进阶 文章标签： fpga开发
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这篇博客探讨了RAM的分类，包括单口RAM、伪双口RAM和真双口RAM。重点在于如何利用单口RAM实现FIFO，虽然单口RAM的读写不能同时进行，但通过设定读写优先级（如写优先），可以实现同步FIFO。文中提供了相关代码，并通过仿真验证了FIFO功能的正确性。

RAM分类

RAM按照端口数目，可以分为

单口RAM

在这里插入图片描述
单端口RAM只有一组数据线和一组地址线，只有一个时钟，读写共用地址线。输出只有一个端口。
所以单端口RAM的读写操作不能同时进行。当wea拉高时，会将数据写入对应的地址，同时douta输出的数据与此时写入的数据是一致的，因此在读的时候需要重新生成对应的读地址给addra，并且disable掉wea。

伪双口RAM

在这里插入图片描述
输入有一组数据线，两组地址线，两个时钟。
所以一个端口只读，另一个端口只写，但写入和读取的时钟可以不同，且位宽比可以不是1:1。即允许写A的同时读B，且速率可以不同。

真双口RAM

在这里插入图片描述
输入有两组地址线和两组数据线，两个时

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单端口RAM
小柚子的博客
04-10 1368
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FPGA开发——IP核的RAM调用（单端口）
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FIFO专题之单口RAM实现FIFO（同步）
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05-11 6967
使用单口RAM实现FIFO，其实很简单，其中的重点就是区分出读写， 读写如果同时启动，你肯定会思考单口RAM肯定会出问题，毕竟单口RAM只有一个口，肯定不能实现同时读写，那么怎么解决这个问题呢。 有两种办法： 第一种办法就是采用两个单口RAM，这样就可以了，两个单口RAM分开奇偶，相当于乒乓的意思，然后再加一个REG，这就相当于把读写分开了 那么就可能分为以下几种情况： ①同时读写：读写同时为奇，这种情况就是在当前一拍，将写数据存入REG中，并将REG_VALID拉高告诉FIFO我下一拍要写数据，
双口RAM的Verilog实现与应用
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07-17 953
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FPGA串口数据包协议解析后的通过单口RAM和FIFO数据存储
02-22
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基于 FPGA 的高级数字电路设计（7）单口 RAM、同步 FIFO、异步 FIFO 设计
新芯设计的博客
10-03 1271
基于 FPGA 的高级数字电路设计（7）单口 RAM、同步 FIFO、异步 FIFO 的设计
数字IC设计系列----单端口RAM、双端口RAM、同步FIFO、异步FIFO
moshanghongfeng的博客
10-03 4903
目录 一、单端口RAM原理及实现 1.原理 2.Verilog实现 3.优缺点分析 二、双端口RAM原理及实现 1.原理 2.Verilog实现 3.优缺点分析 三、同步FIFO原理及实现 1.原理 2.Verilog实现 3.优缺点分析 四、异步FIFO原理及实现 1.原理 2.Verilog实现 3.优缺点分析 总结 提示：以下是本篇文章正文内容，下面案例可供参考 一、单端口RAM原理及实现 1、原理 在内存空间中开辟出一段
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深度为8，位宽为8bit的单端口RAM
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单端口RAM只有一套地址总线，读操作和写操作是分开的。 module one_bit_fulladder(clk,addm,cs_n,we_n,din,dout); input clk,cs_n,we_n; input [2:0] addm; input [7:0] din; output [7:0] dout; reg [7:0] dout; reg [7:0] raml [7:0]; always @ (posedge clk) begin if(cs_n) dout
同步FIFO设计
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一种单端口ram的写法
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该种写法内部用输入的地址直接作为mem的参数进行地址寻址，比较简洁。
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项目名称 单端口ram读写 设计要求 将0-1023存入ram中并读出，整个过程完成一次读写操作，即只读写一次 设计架构 拉高写使能，只要给出写地址和写数据就可以自动向ram中写入数据 拉高读使能，由于写地址和读地址公用，下一个周期就可以读出数据 特别要注意的是，如果没有读使能，只要给出地址，无论写使能wren是高还是低，一定会把地址指向的数据读出来，即没有读使能只要地址上有数据，数据就会被读出。 如果给出读使能，读使能无效则数据不会被读出。 状态转移图 代码设计 veril
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前面有博文写了同步读写和异步读、同步写的单端口RAM设计： 【FPGA】单端口RAM的设计（同步读、同步写） 【FPGA】单端口RAM的设计（异步读、同步写） 这篇博文讲异步读写： 在博文：【FPGA】单端口RAM的设计（异步读、同步写）中已经对异步读与同步读进行了比较，这篇博文要对同步写和异步写做一个比较： 首先是代码上的区别：易知，所谓异步写，也就是不依赖于时钟的写，只要给一个地址，...
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