Cadence Allegro 导出Slot Hole Report报告详解

已于 2023-03-28 00:02:40 修改
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分类专栏： 《Cadence 开发合集》 # 《Cadence PCB宝典》 文章标签： 硬件开发 Cadence Allegro
于 2023-03-27 23:54:05 首次发布
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本文链接：https://blog.csdn.net/fydar/article/details/129806886
本文详细介绍了Cadence Allegro中的Slot Hole Report，包括其作用、示例和两种导出方法。Slot Hole Report是用于展示PCB开槽的几何尺寸和位置信息的报告，内容涵盖SLOT_TYPE、SLOT_SIZE_MAJOR、SLOT_SIZE_MINOR等关键参数。导出报告的方法包括通过Tools菜单的Report选项或Quick Reports快捷方式。

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Allegro如何在PCB上开槽的三种方法操作指导
weixin_54787054的博客
12-02 9779
当PCB有特殊设计要求的时候，需要在PCB上开槽，Allegro支持在PCB上开槽操作，具体操作如下。槽位做好之后，需要给它们周围做一个禁布，避免走线和器件在里面，因为是需要挖空的，操作如下。画在Board Geometry-outline层，type选择Unfilled。同样选择画在outline层，type选择Unfilled。同样选择画在outline层，type选择Unfilled。在需要开槽的地方画一个方形的槽位即可。在需要的位置画出一个圆形的槽位。在需要的位置画出一个异形的槽位。
Allegro如何检查过孔是否重叠的四种方法操作指导
weixin_54787054的博客
12-08 5574
当过孔只有部分重叠，即便同名网络过孔DRC打开，仍然无法以DRC的形式显示，如下图。Allegro可以检查过孔是否重叠，避免重孔的情况的出现，具体检查方法如下。检查方法如下，Enable DRC，并且打开Constraint Mode。检查方法如下，Enable DRC，并且打开Constraint Mode。可以看到非同名网络过孔，孔重叠在一起的情况以DRC形式报出来了。打开All层DRC，过孔完全重叠的地方以DRC形式报出来了。可以看到过孔的pad部分重叠的情况以DRC形式报出来了。
allegro 通孔焊盘制作
俸禄的小三
02-28 1874
通孔焊盘制作，比如插针封装 实际孔径大小是0.64mm，那么在做通孔焊盘时钻孔直径0.64+0.3（12mil）=0.94mm，焊盘大小= 0.94 + 0.8 = 1.74mm。 在做Flash时，内径 = 0.94 + 0.5 = 1.44mm，外径 = 0.94 + 0.8 = 1.74mm，开口大小 = 0.64。图中阴影部分是要被扣掉的，只留开口地方与负片进行连接。 （1）
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Allegro在PCB上开槽操作方法
Cadence笔记——PCB出gerber
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fydar的博客
04-09 1113
本文简单介绍什么是Symbol Pin Report，以及该报告作用和导出方法。
Cadence Allegro 导出Pin Swap Report报告详解
fydar的博客
03-22 1276
本文简单介绍什么是Pin Swap Report，以及该报告作用和导出方法。
Cadence Allegro 导出Place Component Report报告详解
fydar的博客
03-22 687
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Cadence Allegro 导出Properties on Nets Report报告详解
fydar的博客
03-24 706
本文简单介绍什么是Properties on Nets Report，以及该报告作用和导出方法。
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sdkdlwk的博客
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20180509-Allegro 16.6 含有槽孔的PCB出钻孔文件的注意事项
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xingsongyu的博客
06-13 2811
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