从零开始讲DDR（9）——AXI 接口MIG 使用（2）

最新推荐文章于 2025-05-14 19:00:00 发布
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分类专栏： FPGA接口开发 文章标签： fpga开发 fpga DDR4
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一、前言

        在之前的文章中，我们介绍了官方DDR MIG AXI接口的例程的整体框架，在本文中，我们将着重介绍例程中关于数据产生，及驱动到AXI接口的相关逻辑实现。

二、data_gen

        在例程中，有ddr4_v2_2_8_data_gen这样一个文件，该模块是DDR4测试系统中的数据引擎，负责生成各类测试数据模式及对应的字节使能信号(Strobe)。

        首先，我们关注它的参数接口，前面的ID，ADDR,DATA和WSTRB都很好理解，不需要解释，后面提到的几个参数则对应了不同的数据模式：

   parameter C_DATA_PATTERN_PRBS      = 3'd1,
   parameter C_DATA_PATTERN_WALKING0  =
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weixin_39708636的博客
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